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Design Compiler Graphical
フィジカル?インプリメンテーションを加速するためのより优れたスタートポイントの作成
常に革新的な合成テクノロジを提供し続けるシノプシスは、Design Compiler? Graphicalにより、フローを簡素化し、デザイン?インプリメンテーションにおけるスピードと予測性を向上させる革新的な合成テクノロジをお届けします。Design Compiler Graphicalでは、正確なネット遅延モデリングと高度の最適化を使用して、配置後のタイミングを5%高速化できます。DC Ultra?のトポグラフィカル?テクノロジを拡張して、IC Compiler IIにフィジカル?ガイダンスを提供し、合成と配置間のタイミングと面積の相関を5%以内にまで近づけ、またIC Compiler IIの配置を1.5倍に高速化します。
主な特长
- 高度の最适化により、最适なタイミング蚕辞搁に至る时间を10%短缩
- IC Compiler IIに対するフィジカル?ガイダンスにより、合成と配置間のタイミング、面積、パワーの相関を5%以内にまで近づけ、また配置を1.5倍高速化
- 正确な合成前および后の配线混雑予想および混雑度ドリブンの最适化により配线が容易に
- ゲート間の最適化により、タイミングQoRを維持しながら新規またはレガシー设计の面積を縮小
- RTLと、スケマティック、タイミング?レポート、フィジカルビューなどの设计ビューとの間をクロスプローブすることにより、デバッグを高速化
- 设计初期でフィジカル设计を可視化およびデバッグすることにより、フィジカル?インプリメンテーション前にレイアウトの問題を特定
- フロアプラン?エクスプロレーションにより、最适なフロアプランにより早く到达
- 4コア?サーバ上での実行速度を2倍高速化
- コンカレントなマルチコーナー、マルチモード（惭颁惭惭）合成
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